Desarrollo de un labtool sobre Zynq UltraScale+ para comunicaciones multipunto y tranmisiones multigigabit
[ES] Este trabajo final de máster presenta el desarrollo de una herramienta de laboratorio (labtool) basada en una FPGA Zynq UltraScale+ para la validación de comunicaciones multipunto y enlaces de transmisión multigigabit, orientada a entornos de simulación en electrónica espacial. El desarrollo se...
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| Tipo de recurso: | tesis de maestría |
| Fecha de publicación: | 2025 |
| País: | España |
| Institución: | Universitat Politècnica de València (UPV) |
| Repositorio: | RiuNet. Repositorio Institucional de la Universitat Politécnica de Valéncia |
| Idioma: | español |
| OAI Identifier: | oai:riunet.upv.es:10251/227871 |
| Acceso en línea: | https://riunet.upv.es/handle/10251/227871 |
| Access Level: | acceso abierto |
| Palabra clave: | Field Programmable Gate Array (FPGA) Codiseño Aurora Comunicaciones multipunto Transceiver Labtool Petalinux High Speed Serial Link (HSSL) SpaceWire (SpW) Codesign Multicast Communications Multigigabit (MGB) Herramienta de laboratorio Programmable logic (PL) Zynq UltraScale+ Máster Universitario en Ingeniería de Sistemas Electrónicos-Màster Universitari en Enginyeria de Sistemes Electrònics |
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Desarrollo de un labtool sobre Zynq UltraScale+ para comunicaciones multipunto y tranmisiones multigigabitLabTool Development on Zynq UltraScale+ for Multicast Communications and Multigigabit TransmissionsDesenvolupament d&aposuna labtool sobre Zynq UltraScale+ per a comunicacions multipunt i transmissions multigigabitLópez Sacristán, XavierField Programmable Gate Array (FPGA)CodiseñoAuroraComunicaciones multipuntoTransceiverLabtoolPetalinuxHigh Speed Serial Link (HSSL)SpaceWire (SpW)CodesignMulticast CommunicationsMultigigabit (MGB)Herramienta de laboratorioProgrammable logic (PL)Zynq UltraScale+Máster Universitario en Ingeniería de Sistemas Electrónicos-Màster Universitari en Enginyeria de Sistemes Electrònics[ES] Este trabajo final de máster presenta el desarrollo de una herramienta de laboratorio (labtool) basada en una FPGA Zynq UltraScale+ para la validación de comunicaciones multipunto y enlaces de transmisión multigigabit, orientada a entornos de simulación en electrónica espacial. El desarrollo se ha realizado en el marco de uno de los proyectos de la empresa Tecnobit – Grupo Oesía, dentro del equipo de espacio y tecnologías fotónicas. El planteamiento del problema incluye un estudio de alternativas. Sobre este análisis de alternativas, se decide adoptar el protocolo SpaceWire para las comunicaciones punto a punto, y el protocolo Aurora 8B/10B para las comunicaciones Multigigabit (MGB), que se implementará para un transceptor GTH de la FPGA. El sistema propuesto se implementa sobre una placa de evaluación ZCU102, que integra una arquitectura heterogénea con lógica programable (PL) y procesador embebido (PS). El trabajo desarrollado abarca el diseño hardware en VHDL usando Vivado, tanto para la transmisión de datos con Aurora, como para su control; la implementación de controladores software en C usando Vitis, para la gestión del flujo de datos desde memoria DDR4, y por último, la integración de estas funcionalidades con el resto del sistema.[EN] This master's thesis presents the development of a laboratory tool (labtool) based on a Zynq UltraScale+ FPGA for the validation of point-to-point communications and multigigabit transmission links, aimed at simulation environments in space electronics. The problem statement includes a study of alternatives. Based on this analysis, it was decided to adopt the SpaceWire protocol for multicast communications, whose development and implementation are not part of this work, and the Aurora 8B/10B protocol, which will be implemented for a GTH transceiver of the FPGA. The proposed system is implemented on a ZCU102 evaluation board, which integrates a hybrid architecture with programmable logic (PL) and an embedded processor (PS). The work developed includes hardware design in VHDL using Vivado, both for data transmission with Aurora and for its control; the implementation of software drivers in C using Vitis, for managing the data flow from DDR4 memory; and finally, the integration of these functionalities with the rest of the system.Universitat Politècnica de ValènciaValls Coquillat, JavierRioja Ibañez, JosepDepartamento de Ingeniería ElectrónicaInstituto Universitario de Telecomunicación y Aplicaciones MultimediaEscuela Politécnica Superior de GandiaRepositorio Institucional de la Universitat Politècnica de València Riunet20252025-10-1020252025-09-22master thesishttp://purl.org/coar/resource_type/c_bdccinfo:eu-repo/semantics/masterThesisapplication/pdfhttps://riunet.upv.es/handle/10251/227871reponame:RiuNet. Repositorio Institucional de la Universitat Politécnica de Valénciainstname:Universitat Politècnica de València (UPV)Españolspaopen accesshttp://purl.org/coar/access_right/c_abf2Reserva de todos los derechoshttp://rightsstatements.org/vocab/InC/1.0/info:eu-repo/semantics/openAccessoai:riunet.upv.es:10251/2278712026-06-13T07:49:27Z |
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[ES] Este trabajo final de máster presenta el desarrollo de una herramienta de laboratorio (labtool) basada en una FPGA Zynq UltraScale+ para la validación de comunicaciones multipunto y enlaces de transmisión multigigabit, orientada a entornos de simulación en electrónica espacial. El desarrollo se ha realizado en el marco de uno de los proyectos de la empresa Tecnobit – Grupo Oesía, dentro del equipo de espacio y tecnologías fotónicas. El planteamiento del problema incluye un estudio de alternativas. Sobre este análisis de alternativas, se decide adoptar el protocolo SpaceWire para las comunicaciones punto a punto, y el protocolo Aurora 8B/10B para las comunicaciones Multigigabit (MGB), que se implementará para un transceptor GTH de la FPGA. El sistema propuesto se implementa sobre una placa de evaluación ZCU102, que integra una arquitectura heterogénea con lógica programable (PL) y procesador embebido (PS). El trabajo desarrollado abarca el diseño hardware en VHDL usando Vivado, tanto para la transmisión de datos con Aurora, como para su control; la implementación de controladores software en C usando Vitis, para la gestión del flujo de datos desde memoria DDR4, y por último, la integración de estas funcionalidades con el resto del sistema. |
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