Técnicas HW/SW para reducir la presión sobre la Jerarquía de memoria
Tomando como plataforma de evaluación uno de los tipos de procesador más extendidos, los RICS de 32 bits para sistemas empotrados, este trabajo se plantea dos objetivos distintos y complementarios. El primero tiene una perspectiva software y consiste en evaluar el impacto en la jerarquía de memoria...
| Autor: | |
|---|---|
| Tipo de documento: | dissertação |
| Data de publicação: | 2008 |
| País: | España |
| Recursos: | Universidad Complutense de Madrid (UCM) |
| Repositório: | Docta Complutense |
| Idioma: | espanhol |
| OAI Identifier: | oai:docta.ucm.es:20.500.14352/54487 |
| Acesso em linha: | https://hdl.handle.net/20.500.14352/54487 |
| Access Level: | Acceso aberto |
| Palavra-chave: | 004.25(043.3) 004.33(043.3) Memory gap Jerarquía de memoria System/360 Model 85 Asignación de registros IRC LS UCB CGC Filtro de acceso a pila Hardware |
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Técnicas HW/SW para reducir la presión sobre la Jerarquía de memoriaGonzález Alberquilla, Rodrigo004.25(043.3)004.33(043.3)Memory gapJerarquía de memoriaSystem/360 Model 85Asignación de registrosIRCLSUCBCGCFiltro de acceso a pilaHardwareTomando como plataforma de evaluación uno de los tipos de procesador más extendidos, los RICS de 32 bits para sistemas empotrados, este trabajo se plantea dos objetivos distintos y complementarios. El primero tiene una perspectiva software y consiste en evaluar el impacto en la jerarquía de memoria de la asignación de registros llevada a cabo por el compilador. Para ello se estudiarán comparativamente diversos algoritmos de asignación empleando el mismo entorno experimental. el segundo objetivo, cuyo enfoque es hardware, consiste en diseñar un mecanismo de filtrado para reducir los accesos a la región de memoria de pila, originados por el desalojo de datos ubicados en registros y el paso de parámetros a funciones. La finalidad de este filtro es reducir el consumo de primer nivel de cache, una de las principales fuentes de disipación de energía del procesador.Tirado Fernández, FranciscoPiñuel Moreno, LuisUniversidad Complutense de Madrid20082008-01-0120082008-01-01master thesishttp://purl.org/coar/resource_type/c_bdccinfo:eu-repo/semantics/masterThesisapplication/pdfhttps://hdl.handle.net/20.500.14352/54487reponame:Docta Complutenseinstname:Universidad Complutense de Madrid (UCM)Españolspaopen accesshttp://purl.org/coar/access_right/c_abf2Atribución-NoComercial 3.0 Españahttps://creativecommons.org/licenses/by-nc/3.0/es/info:eu-repo/semantics/openAccessoai:docta.ucm.es:20.500.14352/544872026-06-02T12:44:21Z |
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Tomando como plataforma de evaluación uno de los tipos de procesador más extendidos, los RICS de 32 bits para sistemas empotrados, este trabajo se plantea dos objetivos distintos y complementarios. El primero tiene una perspectiva software y consiste en evaluar el impacto en la jerarquía de memoria de la asignación de registros llevada a cabo por el compilador. Para ello se estudiarán comparativamente diversos algoritmos de asignación empleando el mismo entorno experimental. el segundo objetivo, cuyo enfoque es hardware, consiste en diseñar un mecanismo de filtrado para reducir los accesos a la región de memoria de pila, originados por el desalojo de datos ubicados en registros y el paso de parámetros a funciones. La finalidad de este filtro es reducir el consumo de primer nivel de cache, una de las principales fuentes de disipación de energía del procesador. |
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