Caracterització elèctrica de circuits CMOS digitals amb defectes tipus pont: implicacions al test per corrent quiescent

La tesis contribuye a los esfuerzos dirigidos a la consecución de modelaciones precisas de los fallos de tipo puente. La tecnología de los circuitos digitales considerados es la CMOS estática. En la tesis se utiliza un modelo eléctrico realista para los puentes consistentes en una conexión resistiva...

Descripción completa

Detalles Bibliográficos
Autor: Rodríguez Montañés, Rosa
Tipo de recurso: tesis doctoral
Estado:Versión publicada
Fecha de publicación:1992
País:España
Institución:CBUC, CESCA
Repositorio:TDR. Tesis Doctorales en Red
OAI Identifier:oai:www.tdx.cat:10803/6362
Acceso en línea:http://www.tdx.cat/TDX-0722109-133205
http://hdl.handle.net/10803/6362
https://dx.doi.org/10.5821/dissertation-2117-93674
Access Level:acceso abierto
Palabra clave:621.3
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